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提问人:网友cain3408 发布时间:2022-01-07
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用同步时序逻辑电路设计CP1信号、CP2信号产生电路。 [图...

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第1题
用异步时序逻辑电路设计CP1信号、CP2信号产生电路。 [图...

用异步时序逻辑电路设计CP1信号、CP2信号产生电路。

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第2题
CP1信号、CP2信号可以由几进制计数器来实现?

A.1

B.2

C.3

D.4

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第3题
74LS90时钟信号CP与CP2相连QD与CP1相连,则组成()计数器。
74LS90时钟信号CP与CP2相连QD与CP1相连,则组成()计数器。

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第4题
总线操作实现数据传输,可以不使用时钟信号的同步方式是______。

A.同步时序

B.半同步时序

C.异步时序

D.交叉时序

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第5题
设有关系模式:CP(产品编号,产品名,生产厂商,联系人,联系电话),将其规范为第三范式,正确的是________。

A.CP1(产品编号,产品名);CP2(生产厂商,联系人,联系电话)

B.CP1(产品编号,生产厂商,联系人,联系电话);CP2(产品编号,产品名)

C.CP1(产品编号,产品名,生产厂商);CP2(生产厂商,联系人,联系电话)

D.CP1(产品编号,产品名,生产厂商);CP2(联系人,联系电话)

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第6题
下列有关异步时序逻辑电路的特点说法错误的是:

A.其工作频率范围相对较窄,即工作频率不宜过高

B.不容易产生竞争-冒险

C.其设计步骤与同步时序逻辑电路设计步骤完全相同

D.所设计的电路一般较同步时序逻辑电路复杂。

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第7题
同步时序电路设计中,状态编码采用相邻编码法的目的是(...

同步时序电路设计中,状态编码采用相邻编码法的目的是()

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第8题
关于同步时序逻辑电路和异步时序逻辑电路,选择下面正确的说法: ()

A.同步时序逻辑电路的状态改变是和时钟信号的触发边沿同步的,而异步时序逻辑电路的状态改变不受时钟信号的统一控制。

B.同步时序逻辑电路一定有时钟信号,但是异步逻辑电路可以没有时钟信号。

C.同步时序逻辑电路中一定有存储元件,但是异步时序逻辑电路中可以不用存储状态。

D.同步时序逻辑电路可以没有反馈结构,但是异步时序逻辑电路一定要有反馈结构。

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第9题
某控制系统要求在CP的作用下产生时序信号va、vb。两信号与CP的时序关系如图题9.1.6所示。
用4位二进制计数器74LVC161、集成单稳74121设计该信号产生电路,试画出无识别结果电路图。

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第10题
组合逻辑电路设计中逻辑抽象的目的是得到______。而时序电路设计中逻辑抽象的目的是得到______。
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