题目内容
(请给出正确答案)
提问人:网友wlpshhh
发布时间:2022-01-07
[主观题]
已知函数F=A+BC,使用CPLD的原理(乘积项电路)实现电路。
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设CPLD中某宏单元编程后电路如下图所示,图中画出了S1~S8和M1、M3编程后的连接。数据分配器S1~S8未被选中的输出为0。已知各乘积项如下图中所示。
若某CPLD中的逻辑块有36个输入(不含全局时钟、全局使能控制等),16个宏单元。理论上,该逻辑块可以实现多少个逻辑函数?每个逻辑函数最多可有多少个变量?如果每个宏单元包含5个乘积项,通过乘积项扩展,逻辑函数中所能包含的乘积项数目最多是多少?
A.FPGA器件采用查找表LUT结构来实现逻辑功能。
B.CPLD器件采用乘积项PT结构来实现逻辑功能。
C.CPLD器件为分段式互连结构,内部延时与器件结构和逻辑连接等有关,因此传输时延不可预测
D.SOPC器件采用集查找表LUT、乘积项PT和存储于一体的多核结构来实现逻辑功能。
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