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提问人：网友anonymity 发布时间：2022-01-06

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用ispLS11032设计1个1位十进制计数（8421码表示)的加法器。

用ispLS11032设计1个1位十进制计数(8421码表示)的加法器。

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第1题

用D触发器设计一个8421码的同步模10加法计数器，当计数器值为奇数时，输出Z为1，否则Z为0。下面给出的设计过程错误的是（）。

A、需要4个D触发器

B、状态转换图：

C、需要5个D触发器

D、驱动方程及输出方程：

E、驱动方程及输出方程：

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第2题

可预置数的加/减十进制计数器74LS192芯片组成下图所示电路。请确定计数器的模M为多少？

A、31

B、30

C、33

D、32

E、13

F、3

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第3题

8421BCD码的二―十进制计数器状态是（）时，再输入一个计数脉冲，计数状态为0000，然后向高位发进位信号。

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第4题

要构成1位十进制计数器，至少需要（）触发器。

A、2个

B、4个

C、8个

D、10个

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第5题

4、二进制加法计数器从0计数到十进制24时，需要5个触发器构成，有7个无效状态。 A 正确 B 错误

A、A

B、B

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第6题

利用同步二进制加法计数器74161，采用异步清零法实现十进制计数功能，试分析图中与非门输入端A应连接的计数器输出端是：。

A、Q0

B、Q1

C、Q2

D、Q3

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第7题

74X163的RCO输出有效条件是：仅当使能信号ENT有效，并且计数器的状态是15。

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第8题

设取样积分器的积累次数为100，则积累以后信号噪声幅值比（SNIR）改善 ( ) 倍

A、10000

B、100

C、14.1

D、10

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第9题

用JK触发器按8421码设计一个同步六进制加法计数器，初始状态为000。（只要写出相应设计方程，不需要画出电路图）

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第10题

74LS290型计数器是异步二–五–十进制计数器。

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