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提问人：网友anonymity 发布时间：2022-01-07

[主观题]

若某CPLD中的逻辑块有36个输入（不含全局时钟、全局使能控制等)，16个宏单元。理论上，该逻辑块可以实现多少个逻

若某CPLD中的逻辑块有36个输入(不含全局时钟、全局使能控制等)，16个宏单元。理论上，该逻辑块可以实现多少个逻辑函数？每个逻辑函数最多可有多少个变量？如果每个宏单元包含5个乘积项，通过乘积项扩展，逻辑函数中所能包含的乘积项数目最多是多少？

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更多“若某CPLD中的逻辑块有36个输入（不含全局时钟、全局使能控制等)，16个宏单元。理论上，该逻辑块可以实现多少个逻”相关的问题

第1题

特殊标注位存储器SM0.4提供一个1分钟周期的时钟脉冲。

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第2题

用同步时序逻辑电路设计CP1信号、CP2信号产生电路。 [图...

用同步时序逻辑电路设计CP1信号、CP2信号产生电路。

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第3题

在程序查询方式的输入输出系统中，假设不考虑处理时间，每一次查询操作需要100个时钟周期，CPU的时钟频率为50MHz。CPU必须每秒对鼠标进行60次查询，则CPU对鼠标查询所花时间占用CPU时间的比率为___

A、0.012%

B、0.006%

C、0.024%

D、0.01%

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第4题

异步时序电路中，各个触发器的时钟脉冲不同，电路状态改变时，电路中要更新状态的触发器的翻转有先有后，是异步进行的。

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第5题

在RIP中有三个重要的时钟，其中路由清除时钟一般设为（）。

A. 90秒路由无效时钟

B. 不确定

C. 30秒路由更新时钟

D. 270秒

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第6题

假定编译器对C源程序中的变量和MIPS寄存器进行了以下对应：变量f,g,h,i和j分别分配到寄存器 $s0, $s1, $s2, $s3, $s4，并将一条C赋值语句编译后生成如下汇编代码序列： add $t0, $s1, $s2 add $t1, $s3, $s4 sub $s0, $t0, $t1

A、f=(g+i)-(h+j)

B、f=(g+j)-(h+i)

C、f=(g+h)-(i+j)

D、f=(i+j)-(g+h)

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第7题

异步时序逻辑电路中各个触发器所用的时钟触发沿不完全相同。()

此题为判断题(对，错)。

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第8题

芯片74LVC161和PROM组成图示电路，该电路是一个能产生位的π 函数发生器。

A、16

B、10

C、11

D、8

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