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提问人:网友zwh258 发布时间:2022-01-07
[主观题]

DC使用retiming策略,可在时序路径上前后移动寄存器,以提高电路的时序性能。retime在优化过程中,如果有违例的路径,则调整寄存器的位置。如果没有违例的路径,则可用来减少寄存器的数量。

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第1题
如果电路中所有时序路径都是寄存器到寄存器的路径,那么约束输入延迟对优化电路中的组合逻辑并无作用。
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第2题
DC在逻辑综合阶段会将时序路径划分为 种
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第3题
时序分析中,数据到达时间=时钟到达时间+寄存器输出时间+数据路径延迟。
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第4题
下列电路中不属于时序逻辑电路的是()电路。

A.计数器

B.寄存器 图1

C.编码器

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第5题
下列电路中不属于时序逻辑电路的是()。A.计数器B.全加器C.寄存器D.分频器

下列电路中不属于时序逻辑电路的是()。

A.计数器

B.全加器

C.寄存器

D.分频器

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第6题
寄存器属于()。

A.模拟电路

B.基本门电路

C.组合逻辑电路

D.时序逻辑电路

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第7题
下列电路中为时序逻辑电路的是 。

A.寄存器

B.译码器

C.数据选择器

D.编码器

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第8题
时序电路在输入有限个CP时钟后,则进入有效循环,称 电路。

A.自启动

B.同步时序

C.异步时序

D.摩尔电路

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第9题
请判断以下哪个电路不是时序逻辑电路()

A.计数器

B.寄存器

C.译码器

D.触发器

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第10题
下列电路不属于时序逻辑电路的是()。

A.同步计数器

B.数码寄存器

C.数据选择器

D.异步计数器

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