某型MIPS32指令架构的单周期CPU,其数据通路结构如下图执行指令sub rd, rs, rt 时,应由控制器产生的控制信号PCSrc、regDst、aluSrc、memtoReg、RegWrite分别是() (单选)
A.0、1、0、0、1
B.1、1、0、0、0
C.1、0、1、0、1
D.0、1、0、1、0
- · 有4位网友选择 D,占比36.36%
- · 有4位网友选择 A,占比36.36%
- · 有2位网友选择 B,占比18.18%
- · 有1位网友选择 C,占比9.09%
A.0、1、0、0、1
B.1、1、0、0、0
C.1、0、1、0、1
D.0、1、0、1、0
A、在lw/sw指令数据通路中,一定有一个符号扩展部件用于偏移量的扩展
B、在lw/sw指令数搌通路中,ALU的控制信号一定为“add”(即ALU做加法)
C、寄存器堆的“写使能”信号在lw指令执行时为“1”,在sw指令执行时为“0”
D、数据存储器的“写使能”信号在lw指令执行时为“0”,在sw指令执行时为“1”
A、1.25
B、0.625
C、2.5
D、0.125
A、J型指令支持无条件跳转指令
B、J型指令只使用伪直接寻址方式
C、J 型指令执行后 ,PC寄存器的值最后两位一定为00
D、所有J型指令均不使用MIPS的任何通用寄存器
A、I型指令包括访问内存的指令
B、I 型指令包括条件转移指令
C、I型指令包括算术运算型指令
D、I 型指令支持给寄存器赋立即数的操作
A、不同功能的R型指令使用的寄存器数量不一定相同
B、所有R型指令的操作码OP字段的值均为 000000
C、R型指令既有算术运算指令,也有逻辑运算指令
D、R型指令不支持访问主存的指令
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