题目内容
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试设计一个3变量排队电路。电路有三个输入信号A，B，C，三个输出信号YA，YB，YC；要求：三个信号A，B，C单独输入时，分别输出YA，YB，YC；当多个信号同时输入时，任一时刻只能输出优先级最高的一个信号。优先级顺序依次是A，B，C。
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A、设计完成的逻辑图为：
B、设计完成的逻辑图为：
C、真值表为：
D、真值表为：
E、化简后的逻辑函数表达式为：
(1)A=1时,不论B、C、D为何值,W灯亮,其余灯不亮;
(2)A=0,B-1时,不论C、D为何值,X灯亮,其余灯不亮;
(3)A=B=0,C=1时,不论D为何值,Y灯亮,其余灯不亮:
(4)A=B=C=0,D=1时,Z灯亮,其余灯不亮;
(5)A=B=C=D=0时,所有灯都不亮.
A、组合逻辑电路中的竞争是由逻辑设计错误引起的。
B、在组合逻辑电路中，由竞争引起的险象是一种瞬间的错误现象。
C、在组合逻辑电路中，险象只有在输入变量的取值为某种特定情况下才会发生。
D、可以采用增加冗余项的方法消除险象
E、在组合逻辑电路中，由竞争引起的险象时时刻刻都有，是无法避免的。
A、共有4处，如下图
B、共有3处，如下图
C、共有2处，如下图
D、共有3处，如下图
A、门3
B、门2
C、门1
D、门4
A、门4
B、门7
C、门2
D、门1
E、门3
F、门5
G、门6
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