集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门(规定与非门)设计一
集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门(规定与非门)设计一个全减器;设Ai为被减数,Bi为减数,低位向该位的借位为小差为Di向高位借位为Ji+1.
(1)列出全减器真值表;(2)写出函数逻辑表达式;(3)画出实现逻辑电路图.
集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门(规定与非门)设计一个全减器;设Ai为被减数,Bi为减数,低位向该位的借位为小差为Di向高位借位为Ji+1.
(1)列出全减器真值表;(2)写出函数逻辑表达式;(3)画出实现逻辑电路图.
3线-8线译码器74LS138如图3所示,当要实现逻辑功能,可以将74LS138的()输出管脚做与非运算得到。
A、
B、
C、
D、
E、
F、
G、
H、
10 用集成译码器74LS138和与非门实现下列逻辑函数:
(1)F1(A,B,C)=∑m(2,4,5,7)
(2)F2=A非BC+B非C非
给出74LS161、74LS194、3-8译码器(74LS138)、4选1数据选择器,试设计下列电路:
(1) 波形发生器,要求输出波形如图P6-38(a)所示。
(2)双序列码发生器,要求其输出波形如图P6-38(b)所示。
(3)八路脉冲发生器。
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