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提问人：网友wu16wu16 发布时间：2022-01-07
[单选题]

下图所示组合逻辑电路，输入ABCD为8421码，则电路的输出WXYZ是（）下图所示组合逻辑电路，输入ABCD为8421码，则电路的输出WXYZ是（）

A.余3码

B.8421码对9的补数

C.8421码对6的补数

D.2421码

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匿名网友[240.***.***.48]选择了 C
1天前
匿名网友[82.***.***.62]选择了 D
1天前
匿名网友[137.***.***.122]选择了 C
1天前
匿名网友[92.***.***.113]选择了 B
1天前
匿名网友[204.***.***.167]选择了 C
1天前
匿名网友[104.***.***.64]选择了 C
1天前
匿名网友[224.***.***.214]选择了 C
1天前
匿名网友[172.***.***.107]选择了 B
1天前
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更多“下图所示组合逻辑电路，输入ABCD为8421码，则电路的输出WXYZ是（） ”相关的问题
第1题
用与非门(含非门)设计一个译码线路.输入(A,B,C,D)为8421BCD码,输出控制7段显示管的f极,高电平时f极亮,如图10.80所示,写出F(ABCD)逻辑式,画出逻辑线路图.

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第2题
OC门组成的电路如下图所示，当输入分别是ABC=110、ABC=100时，输出端L1的值分别是（ ）。

A、0,1

B、0,0

C、1,1

D、1,0

E、输出值不确定

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第3题
哪个选项是下面代码的执行结果？ ‪‪‪‪‪‪‪‪‪‪‪‫‪ s="abcd1234" print(s.find("cd"))‪‪‪‪‫‪‪‪‪‪‪‪‪‪‪‪‪

A、2

B、1

C、3

D、4

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第4题
试用二进制同步计数器CT74161设计一个可控BCD码计数器.电路有一个控制端K,当K=0时,电路为8421BCD码计数器;当K=1时,电路为2421BCD码计数器.规定设计电路采用反馈置数法.要求写出设计过程,画出电路图(2421BCD码见表10.7(a),CT74161逻辑符号和功能表见图10.44和表10.7(b)).

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第5题
右图电路，A为8421BCD码十进制加法计数器，B为4位D/A转换器。已知计数器的初态为0000，D/A转换器输入0000～1111所对应的输出电压范围为0 ~ 4.5V，问第15个CP脉冲作用后U0 =( )。

A、0V

B、1.5V

C、3.0V

D、4.5V

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第6题
下图所示组合逻辑电路，其功能是（ ） [图]A、8421码转余3...

下图所示组合逻辑电路，其功能是（ ）

A、8421码转余3码

B、8421码转2421码

C、二进制码转格雷码

D、二进制码转8421码

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第7题
设计一个判断输入8421码表示的十进制数是否大于5的组合逻辑电路，至少需要（ ）个逻辑门。

A、1

B、2

C、3

D、4

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第8题
下列不属于组合逻辑电路中消除险象方法的是（ ）

A、增加冗余项

B、增加惯性延时环节

C、选通法

D、增加触发器

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第9题
利用卡诺图化简函数F(A，B，C，D) = ∑ m（7,11,12,13,14,15）+∑ d（0,2,3,8,10）,求出的最简表达式是（ ）

A、

B、

C、

D、

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第10题
组合逻辑电路中的险象是一种非瞬态现象，能够永久的破坏正常的逻辑关系。
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