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提问人:网友anonymity
发布时间:2022-01-06
[主观题]
基于课本上所示的PLA分别实现表(1)、(2)给出的2位-4线译码器电路。 表(1) 2位-4线译码(正逻辑输出)
基于课本上所示的PLA分别实现表(1)、(2)给出的2位-4线译码器电路。
表(1) 2位-4线译码(正逻辑输出) | |||||||
S1 | bar{S_2} | A1 | A0 | Y0 | Y1 | Y2 | Y3 |
1 1 1 1 0 varphi | 0 0 0 0 varphi 1 | 0 0 1 1 varphi varphi | 0 1 0 1 varphi varphi | 1 0 0 0 0 0 | 0 1 0 0 0 0 | 0 0 1 0 0 0 | 0 0 0 1 0 0 |
表(2) 2位-4线译码(负逻辑输出) | |||||||
S1 | bar{S_2} | A1 | A0 | bar{Y_0} | bar{Y_1} | bar{Y_2} | bar{Y_3} |
1 1 1 1 0 varphi | 0 0 0 0 varphi 1 | 0 0 1 1 varphi varphi | 0 1 0 1 varphi varphi | 0 1 1 1 1 1 | 1 0 1 1 1 1 | 1 1 0 1 1 1 | 1 1 1 0 1 1 |
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