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提问人：网友zhengyuankey
发布时间：2022-01-07
[主观题]
Assign E or Z configuration to the following alken...
Assign E or Z configuration to the following alkenes: (a) (b)
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更多“Assign E or Z configuration to the following alken...”相关的问题
第3题
产生进位信号assign cy=（（EN==1)&&（Q==9))？1'b1:1'b0;语句中，正确的说法是？
A.“？”是条件运算符
B.“？”是关系运算符
C.“？”前的表达式为假时，z=0
D.“？”前的表达式为真时，z=0
第4题
下列说法不正确的是：
A.Verilog描述的任何变量都可能有四种不同逻辑状态的取值：0、1、x和z。
B.Verilog规定assign引导的赋值语句中左侧目标变量的类型必须是网线型wire型。
C.if语句是顺序语句，必须放在过程语句always中使用。
D.case语句是一种多分支语句，多个分支取值之间存在优先级。
第5题
在交换机上可以配置虚拟局域网（VLAN)，以下是部分配置清单。回答问题1、问题2、问题3、问题4和问题5，
在交换机上可以配置虚拟局域网(VLAN)，以下是部分配置清单。回答问题1、问题2、问题3、问题4和问题5，将解答填入对应栏内。
＞enable
gconfigt
Enter configuration commands，one perline.End with CNTL/Z
(config)//了安全和方便起见，我们给这个交换机起个名字，并且设置登录密码。
(config)hostname Cisco
Cisco(config)enable password level 15 goodluck
Cisco(config)
Cisco(config)vlan 2 name ciu_teacher//设置两个VLAN
Cisco(config)vlan 3 name ciu_student
Cisco(config)interface ethernet0/2 //把VLAN都定义到了交换机的端口上
Cisco(config-if)vlan-membership static 2
Cisco(config-if)int e0/3
Cisco(config-if)vlan-membership static 2
Cisco(config-if)inte 0/4
Cisco(config-if)vlan-membership static 2
Cisco (config-if) int e0/5
Cisco (config-if) vlan-membership static 2
Cisco (config-if) iht e0/17
Cisco (config-if) vlan-membership static 3
......
Cisco (config-if) int e0/22
Cisco (config-if) vlan-membership static 3
Cisco (config-if)
Cisco (config) (1) //验证配置
VLAN Name Status Ports
1 default Enabled 1,6-16,22-24,AUI,A,B (2)
2 ciu teacher Enabled 2-5
3 ciu student Enabled 17-22
......
为什么要从vlan2，而不是从vlan1开始配置？
第6题
这段程序描述的逻辑功能为： module Learn1_1（a,b,s,y); input a,b; input s; output y; wire d, e; assign d = a & s; assign e = b & （~s); assign y = d | e; endmodule
A.译码器
B.二选一数据选择器
C.四选一数据选择器
D.计数器
第7题
We assign human and non-human resources in the _____ phase of the budget.A.conceptualB.pla
We assign human and non-human resources in the _____ phase of the budget.
A . conceptual
B . planning
C . development
D . implementation
E . close-out
第8题
这段程序描述的逻辑功能为： module Learn1_2（A,B,Y); input A,B; output Y; wire d, e; assign d = A &B; assign e = （~A )&（~B ); assign Y= d | e; endmodule
A.异或
B.同或
C.半加器
D.比较器
第9题
这段程序描述的逻辑功能是什么？ module Learn1_1（a,b,s,y); input a,b; input s; output y; wire d, e; assign d = a & s; assign e = b & （~s); assign y = d | e; endmodule
A.y=sa+sb
B.y=sa+(~s)b
C.y=(s+a)((~s)+b)
D.y=(~s)a+sb
第10题
作业题4 请在下面的空格中填入适当的符号，使其成为下图的verilog模块： module block1（a, , , , ); input , , ; d, ; assign d = a | （b & ~c) ; assign e = （b & ~c );
作业题4 请在下面的空格中填入适当的符号，使其成为下图的Verilog模块： module block1(a, , , , ); input , , ; d, ; assign d = a | (b & ~c) ; assign e = (b & ~c );
