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提问人：网友lxzpower 发布时间：2022-01-07
[单选题]

边沿型D触发器的逻辑符号如图所示，其输出状态的变化，发生在时钟脉冲CP的 ；已知输入端D=1，在CP触发边沿作用下，其输出端Q为 。边沿型D触发器的逻辑符号如图所示，其输出状态的变化，发生在时钟脉冲CP的 ；已知输入端D=1，在CP

A.上升沿，1

B.下降沿，1

C.上升沿，0

D.下降沿，0

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1天前
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第2题
凡是结构形式上由两个同步触发器级联而成，且它们的时钟信号CP相位相反的触发器均为主从触发器。
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第3题
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第4题
1、如果将边沿D触发器的端和D端相连，则Q端输出脉冲频率为输入时钟脉冲的（） A、二分频 B、二倍频 C、四分频 D、四倍频 2、一个三进制计数器和一个八进制计数器串接起来的最大计数值为（） A、5 B、19 C、23 D、31 3、由四个触发器组成的计数器，状态利用率最高的是（） A、二进制计数器 B、十进制计数器 C、 N进制计数器 D、以上都不对 4、由两个模数分别为M、N的计数器级联成的计数器，其总的模数为（） A、 M+N B、 M-N C、 M*N D、 M÷N 5、加减计数器的功能是（） A、既能进行同步计数又能进行异步计数； B、既能进行二进制计数又能进行十进制计数； C、加法计数和减法计数同时进行； D、既能进行加法计数又能进行减法计数；
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第5题
如图所示电路中，若CP脉冲频率为24M Hz，则Q2端输出信号频率库多少？画出Q1、Q2端波形？设触发器初态为0.。（拍照上传）
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第6题
D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲cp的作用下，输出Q为（）。

A. 1

B. cp

C. 脉冲信号，频率为时钟脉冲频率的1/2

D. 0

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第7题

A、不能自启动的6进制减法计数器。

B、不能自启动的6进制加法计数器。

C、六分频电路。

D、能自启动的6进制计数器。

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第8题
边沿触发型R-S触发器构成的电路如图所示,画出Q的波形,并分析电路功能。
边沿触发型R-S触发器构成的电路如图所示，画出Q的波形，并分析电路功能。

  

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第9题

A、500KHZ

B、200KHZ

C、100KHZ

D、50KHZ

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第10题
边沿型JK触发器的逻辑符号如图所示，已知输入端J=1，K=0，RD=1，其输出端Q为 。

A、0

B、1

C、高阻态

D、无法判断

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