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提问人：网友unipower 发布时间：2022-01-07

[单选题]

下面语句的逻辑功能是（）。 `timescale 10ns/1ns

A.传递参数“1”

B.产生50M时钟输出

C.延时1ns

D.输出取反

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第1题

下面是一个状态机的程序。根据程序描述的逻辑功能,下列说法正确的是()。moduleLearn8_1(clk,din,dout);inputclk,din;outputregdout;reg[1:0]Current_state,Next_state;parameterS0=2'b00,S1=2'b01,S2=2'b10,S3=2'b11;always@(posedgeclk)beginCurrent<=Next;endalways@(Current_stateordin)case(Current_state)S0:begindout=0;if(!din)Next_state=S0;elseNext_state=S1;endS1:begindout=1;if(din)Next_state=S1;elseNext_state=S2;endS2:begindout=0;if(din)Next_state=S2;elseNext_state=S3;endS3:begindout=0;if(!din)Next_state=S3;elseNext_state=S0;enddefault:begindout=0;Next_state=S0;endendcaseendmodule

A、该状态机是mealy型状态机

B、该状态机是moore型状态机

C、该状态机的输出只取决于当前的状态

D、当输入为111001时，输出为0111000

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第2题

写出题图12-1所示逻辑电路输出下的逻辑表达式，并说明其逻辑功能。

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第3题

如果一个if语句的语句部分又是一条if语句，则称为if语句（）。

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第4题

任何Select Case语句都可以改写成If语句，同样，任何If语句也都可以改写成Select Case语句。

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第5题

Python中的语句： temp=['a','1',2,3,None,] print(len(temp)) 其输出结果是_____

A、3

B、4

C、5

D、6

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第6题

分析题图14-1所示时序电路的逻辑功能，并给出时序图。

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第7题

下列语句，输出为True的是（）。

A、print(3 > 3 and 3 > 2)

B、print(2 > 3)

C、print(not 3)

D、print(2 and True)

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第8题

根据这段程序的描述，当输入信号S为11时,其功能为：顶层模块： module learn3_1(A,B,S,Y,carry); input [3:0] A,B; input [1:0] S; output [3:0] Y; output carry; wire [3:0] C; assign C[0]=0; add_full u0(S,A[0],B[0],C[0],Y[0],C[1]), u1(S,A[1],B[1],C[1],Y[1],C[2]), u2(S,A[2],B[2],C[2],Y[2],C[3]), u3(S,A[3],B[3],C[3],Y[3],carry); endmodule 底层模块： module add_full(switch,a,b,c,s,carry); input a,b,c; input [1:0] switch; output reg s,carry; always@(switch) case(switch) 2'b00: begin s=0; carry=0; end 2'b01: begin s=a; carry=0; end 2'b10: begin s=b; carry=0; end 2'b11: begin s=a^b^c; carry=(a&b)|(b&c)|(c&a); end endcase endmodule

A、输出Y为0；

B、输出Y等于A；

C、输出Y 等于B；

D、输出Y为A与B的和。

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第9题

面这段程序中，clk为时钟信号输入。根据程序描述的逻辑功能，下列说法正确的有： module Learn6_1(clk,d,q1,q2,q3); input clk,d; output reg q1,q2,q3; always@(posedge clk) begin q1<=d; end> A、程序功能为移位寄存器；

B、时钟下降沿时触发；

C、q1<=d、q2<=q1、q3<=q2三个语句在时钟边沿作用后同时赋值；<br> D、q1<=d、q2<=q1、q3<=q2三个语句在时钟边沿作用后先后赋值；<br>

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第10题

根据这段程序描述的逻辑功能，下列叙述中正确的有： module Learn(in1,in2,in3,in4,s,y); input [1:0] s; input in1, in2, in3, in4; output reg y; always@(s) case(s) 2'b00: y=in1; 2'b01: y=in2; 2'b10: y=in3; 2'b11: y=in4; endcase endmodule

A、是四选一数据选择器；

B、是二位全加器；

C、不会在所描述的组合逻辑电路中引入锁存器；

D、会在所描述的组合逻辑电路中引入锁存器；

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