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提问人:网友黄平 发布时间:2022-01-06
已知某触发器的时钟CP,异步置0端为RD(低电平有效),异步置1端为SD(低电平有效),控制输入端Vi和输出Q的波形如图所示,根据波形可判断这个触发器是()。
[单选题]

已知某触发器的时钟CP,异步置0端为RD(低电平有效),异步置1端为SD(低电平有效),控制输入端Vi和输出Q的波形如图所示,根据波形可判断这个触发器是()。已知某触发器的时钟CP,异步置0端为RD(低电平有效),异步置1端为SD(低电平有效),控制输入端V

A.下降沿T触发器

B.上升沿D触发器

C.上升沿T触发器

D.下降沿D触发器

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第1题
已知JK触发器的时钟CP的波形、输入端J、K的波形如下图所示,试画出主从型JK触发器和负边沿JK触发器的输出端Q的电压波形,设触发器的初始状态为0。

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第2题
已知某触发器的时钟为CP,异步置0端为RD,异步置1端为SD,Vi和Q为输入和输出,给定如下波形图,根据波形可判断这个触发器是( )。

A、上升沿T触发器

B、下降沿T触发器

C、上升沿D触发器

D、下降沿D触发器

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第3题
逻辑电路如下图所示,设图中各触发器的初态均为“0”。试分析在给定电路输入波形作用下,正确的电路输出波形是 。 (a) (1) (2) (3) (4)

A、图(1)

B、图(2)

C、图(3)

D、图(4)

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第4题
时钟CP波形如图所示,试画出各触发器输出端Q的波形,设Q的初始状态=0.
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第5题
下列描述正确的是 。

A、同步触发器的动作特点是在CP=1(高电平期间)的全部时间内,S、R、D、J、K、T等数据输入端的变化可引起触发器状态发生相应变化,因此常被称为电平触发器。

B、边沿触发器的动作特点是触发器的输出状态仅仅取决于CP脉冲上边沿或下边沿到来时的S、R、D、J、K、T等输入状态,在此前或之后,输入状态的变化对输出状态均无影响。

C、基本RS-FF(SR锁存器) 是构成各种高性能触发器的基本单元。

D、主从类型的触发器一个周期内仅在时钟下降沿有输出,且具有一次变化现象,因而有很强的抗干扰能力。

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第6题
一个T触发器,在T=1,加上时钟信号,则触发器( )。 a. 保持 b.置1 c. 计数

A、a

B、b

C、c

D、都不对

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第7题
时钟CP有效边沿至输出端新状态稳定建立起来的时间定义为触发器的 。

A、传输延迟时间

B、建立时间

C、保持时间

D、触发时间

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第8题
电路如图所示,各触发器的初态均为“0”,在CP第100个脉冲信号结束后,电路的输出Q1和Q2分别为 。

A、0,1

B、1,0

C、0,0

D、1,1

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第9题
维持-阻塞D触发器是()。

A. 上升沿触发

B. 下降沿触发

C. 高电平触发

D. 低电平触发

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