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提问人：网友evae19860928
发布时间：2022-01-06
[主观题]
设计一个三变量的多数表决电路，即电路有A、B、C三个输入端，输出取值与输入的多数变量相同，列出设计过程，画出用与非门组成的电路。
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第1题
用8选1数据选择器设计一个组合逻辑电路。该电路有3个输入逻辑变量A、B、C和1个工作状态控制变量M。当M=0时电路实现“意见一致”功能（A、B、C状态一致时输出为1，否则输出为0），而M=1时电路实现“多数表决”功能，即输出与A、B、C中多数的状态一致。
第2题
用8选1数据选择器74HC151设计一个组合逻辑电路。该电路有3个输入逻辑变量A，B，C和1个工作状态控制变量M。当M=0
时，电路实现“意见一致”功能(A、B、C状态一致时，输出为1，反之输出为0)，而M=1时，电路实现“多数表决”功能，即输出与A、B、C中多数的状态一致。
第3题
用最少的与非门设计一个组合逻辑电路。要求：当控制信号M=1时为“全一致”电路，即当三个输入变量取值全部相同时
输出为1，否则为0；当控制信号M=0时为“多数表决”电路，即输出等于多数输入变量的取值。
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第4题
设计一个三变量的多数表决电路.当输入变量中有两个或两个以上同意时,提议被通过,否则,提议不被通过.具体设计要求如下:（1)全用与非门来实现最简的逻辑电路;（2)用74138来实现,画出逻辑电路图.
第10题
设计以下3变量组合逻辑电路： （1)判奇电路。输入中有奇数个1时，输出为1，否则为0。 （2)判偶电路。输入中有偶数
设计以下3变量组合逻辑电路：
(1)判奇电路。输入中有奇数个1时，输出为1，否则为0。
(2)判偶电路。输入中有偶数个1时，输出为1，否则为0。
(3)判一致电路。输入变量取值相同时，输出为1，否则为0。
(4)判不一致电路。输入变量取值不一致时，输出为1，否则为0。
(5)被3整除电路。输入能被3整除时，输出为1，否则为0。
(6)A，B，C多数表决电路。有2个或2个以上为1时输出才为1，但C有否决权。
