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提问人：网友aoyoudeyu 发布时间：2022-01-07
[单选题]

四位超前进位加法器芯片74283的芯片引脚是（）。

A.8

B.12

C.16

D.24

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1天前
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1天前
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第1题
用Verilog HDL设计1位全加法器的模块如下列代码。阅读后，指出哪一个说法不正确？ module myadd (a, b, cin, sum, cout); //模块名，端口列表 input a, b, cin; //输入端口声明 output sum, cout; //输出端口声明 reg sum, cout; reg m1, m2, m3; //变量声明 always @ (a or b or cin) //always过程连续赋值 begin sum = ( a^b ) ^ cin; m1=a&b; m2=b&cin; m3=a&cin; cout= ( m1|m2 ) | m3; end endmodule //模块结束语句

A、这模块不是全加器，而是半加器。

B、采用了行为的描述方式。

C、只要输入端a，b，c任何一个变化，该模块就会被触发，并执行一次加法。

D、begin-end内的语句是顺序执行的。

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第2题
串行加法器的进位信号采用()传递,而并行加法器的进位信号采用传递.
A.超前,逐位

B.逐位,超前

C.逐位,逐位

D.超前,超前

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第3题
设计一个32位申行进位加法器,要求用异或门和二输入与非门构成,计算加法器的最长运算时间.

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第4题
图10.66所示为四位二进制加法计数器,其功能表见表10.16所示.试将两片CT74161采用同步级联方式及总体反馈归零法设计成一个23进制计数器,要求写出设计过程并画出连接图.

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第5题
图10.64为4位二进制全加器CT74283的逻辑符号.试用此器件及尽可能少的与非门设计一个代码转换电路,实现BCD代码的8421码到2421码的转换,2421码如表10.15所示.

要求写出设计过程,并画出连接图.

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第6题
全并行加法器的优点是（ ），缺点是（ ）。

A、运算速度慢

B、速度最快

C、电路简单

D、电路复杂

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第7题
比较两个多位二进制数时，应首先从（ ）开始，（ ）进行比较。

A、低位

B、高位

C、逐位

D、同时

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第8题
[图]A、进位B、加法C、借位D、减法...

A、进位

B、加法

C、借位

D、减法

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第9题
数值比较器是用来判断两个二进数的大小或（ ）。

A、大小

B、大

C、相等

D、小

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第10题
集成电路芯片7485有（ ）个4位二进制数输入端。

A、1个

B、2个

C、3个

D、4个

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