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提问人：网友xiayan188 发布时间：2022-01-06
[单选题]

某存储器芯片有12根地址线，8根数据线，该芯片有()个存储单元。

A.1KB

B.2KB

C.3KB

D.4KB

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更多“某存储器芯片有12根地址线，8根数据线，该芯片有（)个存储单元。A.1KBB.2KBC.3KBD.4KB”相关的问题
第1题
某存储器芯片有地址线13根，数据线8根、该存储器芯片的存储容量为（）。

A.15K×8

B.32K×256

C.8K×8

D.32K×8

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第2题
某存储器芯片有11根地址线，8根数据线，该芯片有多少个存储单元？（） A、2KB B、3KB C、4KB D、8K B

A.A

B.B

C.C

D.D

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第3题
一个EPROM芯片2732（4K*8b），关于其引脚信号叙述正确的是：

A.有12根地址线，8根数据线，和1根片选信号线，片选信号低电平有效。

B.有13根地址线，3根数据线，和1根片选信号线，片选信号低电平有效。

C.有13根地址线，4根数据线，和1根片选信号线，片选信号高电平有效。

D.有12根地址线，3根数据线，和1根片选信号线，片选信号高电平有效。

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第4题
某8位CPU公有20根地址线（A19~A0），8根数据线（D7~D0），现用4片256K*8位的存储器芯片（Chip3~Chip0）采用4体交叉方式、字扩展，构成该CPU的最大存储空间，Chip3构成高位字节。若CPU要访问地址为12345H的内存单元，则应将（）的片选设为有效。

A.Chip3

B.Chip2

C.Chip1

D.Chip0

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第5题
某8位CPU共有20根地址线（A19~A0），8根数据线（D7~D0），现用4片256K*8位的存储器芯片（Chip0~Chip3）采用4体交叉方式、字扩展（译码器输出端的Y0~Y3分别接chip0~chip3的片选），构成该CPU的最大存储空间。若CPU要访问地址为12345H的内存单元，则应将（）的片选设为有效。

A.Chip3

B.Chip2

C.Chip1

D.Chip0

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第6题
某半导体存储器有8根数据线，13根地址线，则它的存储容量是（)A．8K×8位B．16K×8位C．32K×8位D．64K×8位

某半导体存储器有8根数据线，13根地址线，则它的存储容量是 ()

A．8K×8位

B．16K×8位

C．32K×8位

D．64K×8位

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第7题
设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令, 为

设CPU有16根地址线，8根数据线.并用设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令,作访存控制信号,设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令,作访问I/0端口的控制信号,设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令,为读命令,设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令,为写命令。I/O编址采用单独编址。现有图5. 15所示的芯片及各种门电路(自定):

设CPU有16根地址线，8根数据线.并用 作访存控制信号, 作访问I／0端口的控制信号, 为读命令,

画出CPU和存储芯片及CPU和I/O接口芯片的连接图,要求:

(1)主存除最大地址空间存放系统BIOS程序(约4 KB)外,其余地址空间均为用户所用。

(2)接口芯片的地址范围为80H~87H。

(3)指出选用的存储芯片类型、数量及地址范围。

(4)详细画出存储器芯片和接口芯片的片选逻辑。

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第8题
某存储器具有8根地址线和8根双向数据线,则该存储器的容量为().
某存储器具有8根地址线和8根双向数据线,则该存储器的容量为（).

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第9题
某存储器具有8根地址线和8根双向数据线,则该存储器的容量为().
某存储器具有8根地址线和8根双向数据线,则该存储器的容量为（).

A.8x3b

B.8Kx8b

C.256x8b

D.256x256b

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第10题
存储器的地址线有14根，数据线有8根，其存储容量为______。

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