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提问人：网友anonymity
发布时间：2022-01-06
[主观题]
设X=x3x2x1x0为一个4位二进制数，试设计一个求Y=10X的组合电路。
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第3题
试用译码器 74LS138 和适当的逻辑门设计一个组合电路。该电路输入X与输出L均为三位二进制数。二者之间的关系如下： 当 2≤X≤5 时 L = X + 2 当 X＜2 时 L = 1 当 X＞5 时 L = 0
第4题
用一片8选1数据选择器SN74LS151(逻辑符号如图10.55所示)及门电路设计一个两位二进制无符号数X=X1X0、Y=Y1Y0的数据比较器.当X≥Y时输出Z=1,否则Z=0.要求:
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(1)简要给出设计步骤;
(2)画出逻辑电路图.
第5题
设计一个能实现两个1位二进制数的全加运算和全减运算的组合逻辑电路，加减控制信号用M表示，当M=0时为全加运算，M=1时为全减运算。要求： （1）用最少个数的与非门实现（约定，真值表，卡诺图化简，画出逻辑电路图）（10分）。 （2）74X151国标符号如图所示，用74X151实现（要求有推导过程，画出逻辑电路图）（5分）。 （3）74X138国标符号如图所示，用74X138加必要的门电路实现（要求有推导过程，画出逻辑电路图）（5分）。 
第6题
设计一个可以控制计数功能的计数器,当X=0时,计数器以二进制数序列000、 001、010、011、 100、101、110、111计数并重复。当X=1时,计数器以格雷码序列000、001、 011、 010、 110、111、101、100计数并重复,要求:(1)画出计数器的状态图和ASM图;(2)用Verilog HDL语言描述系统的工作过程。
