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提问人：网友yangpan98
发布时间：2022-03-11
[主观题]
图4.18(教材图4.15)所示的逻辑电路能将D触发器转换成JK触发器,试证明之。
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和波形图) ,设触发器F1和F0的初始状态Q1Q0=00。
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的波形如图21-34(b)所示，试画出两触发器输出端Q的波形。两触发器的初始状态为0。
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别画出输出Q的波形图。
此图所示为SR触发器。（）
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图21.3.1(在教材中)是由主从型JK触发器组成的四位二进制加法计数器。试改变级间的连接方法，画出也是由该触发器组成的四位二进制减法计数器，并列出其状态表。在工作之前先清零，使各个触发器的输出端Q0～Q3均为0。(参照例21.3.1)
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