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提问人:网友yanfa120 发布时间:2022-01-07
[单选题]

下图所示为()。下图所示为()。

A.上升沿RS触发器

B.下降沿RS触发器

C.上升沿JK触发器

D.下降沿JK触发器

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第1题
边沿型D触发器的逻辑符号如图所示,其输出状态的变化,发生在时钟脉冲CP的 ;已知输入端D=1,在CP触发边沿作用下,其输出端Q为 。

A、上升沿,1

B、下降沿,1

C、上升沿,0

D、下降沿,0

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第2题
下图为正脉冲触发的JK触发器,试分析在t1-t2时间段内和t3-t4时间段内Q和Q’的分别是什么( )

A、10 10

B、01 10

C、10 11

D、10 00

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第3题
状态图如图所示,电路的输入为A,输出为Y,试用下降沿触发的D触发器设计该电路,则各个触发器的激励方程及输出方程为 。

A、

B、

C、

D、

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第4题
如图所示是脉冲触发的触发器,它是由两个时钟信号相反的电平触发的触发器组成。( )图片.png
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第5题
上升沿触发的D型触发器的异步置0、置1端分别为[图]时,...

上升沿触发的D型触发器的异步置0、置1端分别为时,触发器的次态 。

A、为0

B、与CP和D有关

C、只与CP正边沿有关

D、为1

E、只与D有关

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第6题
D触发器的输出Q端与一输入信号异或后,接至其输入D端后,则变成了________触发器。

A、JK

B、T

C、T'

D、SR

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第7题
5.5.1 上升沿触发和下降沿触发的D触发器逻辑符号及时钟信号CP()和输入信号D的波形如图题5.5.1所示。分别画出他们的Q端波形。设触发器的初始状态为0。
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第8题
集成触发器芯片74LS74是( )触发方式( )触发器

A、下降沿,JK

B、上升沿,JK

C、下降沿,D

D、上升沿,D

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第9题
若触发器状态不是随计数脉冲CP的输入而同时翻转,该计数方式称为()计数方式。(同步/异步)
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