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提问人：网友yaoshiyu 发布时间：2022-01-07

[主观题]

设下降沿触发的JK触发器初始状态为0，CP、J、K信号如图题5.5.3所示，试画出触发器Q端的输出波形。

设下降沿触发的JK触发器初始状态为0，CP、J、K信号如图题5.5.3所示，试画出触发器Q端的输出波

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第1题

下图所示为（）。 [图]A、上升沿RS触发器B、下降沿RS触发...

下图所示为（）。

A、上升沿RS触发器

B、下降沿RS触发器

C、上升沿JK触发器

D、下降沿JK触发器

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第2题

已知后沿主从触发的JK触发器，J和K端的输入信号波形如图所示，而且已知触发器原为0态，求输出端Q的波形。

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第3题

边沿JK触发器在CP=1期间，J、K端的输入信号发生变化时，对输出Q端的状态没有影响。

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第4题

设主从型JK触发器的初始状态为0。触发器及 J、K、CP端输入信号波形如下图所示，试画出Q端的输出波形。

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第5题

5.5.1 上升沿触发和下降沿触发的D触发器逻辑符号及时钟信号CP（

）和输入信号D的波形如图题5.5.1所示。分别画出他们的Q端波形。设触发器的初始状态为0。

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第6题

边沿D触发器的输出状态Q的取值不仅与时钟信号CLK有关，还与（）有关。

A、反馈信号

B、输入D信号

C、原来的Q状态信号

D、直接置0端

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第7题

设图10.14中所有触发器的初始状态皆为0,找出图中触发器在时钟信号作用下,输出电压波形恒为0的是图().

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第8题

边沿型D触发器的逻辑符号如图所示，其输出状态的变化，发生在时钟脉冲CP的；已知输入端D=1，在CP触发边沿作用下，其输出端Q为。

A、上升沿，1

B、下降沿，1

C、上升沿，0

D、下降沿，0

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第9题

下图中触发器均为下降沿触发结构，且初始状态均为0，则电路在一系列CP信号作用下Q1、Q2、Q3端输出电压波形正确的是（）。

A、

B、

C、

D、

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